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Verilog中缩减运算符 形式如a=^b; a=|b; a=&b

2020年03月05日 FPGA开发 ⁄ 共 114字 ⁄ 字号 Verilog中缩减运算符 形式如a=^b; a=|b; a=&b已关闭评论

如a=^b; a=|b; a=&b,其中a为1位,b>1位

计算过程,以a=&b为例:

b的最低位和b的次低位进行按位与运算,得到的结果在和次高位进行按位与运算。然后结果再和此次高位按位与运算,直到最高位为止,然后将得到的结果赋值给a。

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